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- 阿涛1012844 2024-10-07
- iic的内部架构。
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- 阿涛1012844 2024-10-07
- I方c总线。
读写都是主机发信号。
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- 阿涛1012844 2024-10-07
- 随机存储器。ram
只读存储器，只能读。但是eeprom是可以通过电查处。
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- 阿涛1012844 2024-10-07
- 移位寄存器。第1次上升沿把数据传到a。其余为0。在下一次上升沿a中的数据传到b，然后a的数据在更新。以此类推。
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- 阿涛1012844 2024-10-06
电平触发型d触发器。
时钟CP为0的时候保持输出不变。 Q为1的时候，输入会反馈给输出。
边缘触发型。如上升沿电平触发型，只有当时钟cp从低电平往高电平变化那一段时间可以把输入赋值给输出。其余时间保持输出不变。
PRN有效则强行输出置一。
CLRN有效则强行输出清零。
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- 阿涛1012844 2024-10-06
- 触发器，就是输入端上次输入什么输入端不变的话，它会保持上一次输出端的信号。下图是D触发器。
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- 阿涛1012844 2024-10-06
- Rs485, 设备与总线距离不能超过5米。
最多只能连32台设备。
后面必须要接120欧姆总线末端电阻。
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- 阿涛1012844 2024-10-06
- 数据选择器，根据a1a0选择哪个输入数据进行输出。 如右下角图00则输出D0。
数据分配器。根据选择端对输入数据进行哪位输出，其余位置一。
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- 阿涛1012844 2024-10-06
- 编码器是将n个信号换成n位二进制使用。
译码器，将二进制转为信号。
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- 阿涛1012844 2024-09-23
- 组合逻辑电路设计。
我感觉也可以，bc或，再跟a与。
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- 阿涛1012844 2024-09-23
- 组合逻辑电路的定义。封装好的，没有反馈。
组合逻辑的分析。
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- 阿涛1012844 2024-09-20
- 与或非。还有第2张图片，最下面与反，或反，异或门。
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- 阿涛1012844 2024-09-19
- 如果有字符参与运算，则是这个字符代表的数参与运算。
码制
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- 阿涛1012844 2024-09-18
数字信号不连续的（如从0V突然间跳到3V，也就是说只有0或1），数字电路一般都是这种集成的器件。
模拟是连续的。如下面这个图。
还有就是讲了二进制，八进制，16进制，十进制。- 0赞 · 0采集
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- 阿涛1012844 2024-09-18
基础
这节课内容，编码器，译码器，下面软件
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- 慕运维3368382 2024-04-30
- 拼多多为什么比义务购发展的更好？
一是微信的拼-刀社交裂变′1′丿，为什么，14亿人，lo亿人用，是极致，靠活动与砍一万先获取用户数，比如卫生纸。二是价格优势。
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- 叶建辉 2023-09-08
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- 程序媛张三 2023-09-01
FIFO：
FSM(有限状态机）：
总结：
时序：
状态：
架构：
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- 程序媛张三 2023-09-01
镜头控制：
调整焦距
曝光：明暗
拉伸：放大缩小
SDA传输命令，SCL传输时钟信号。
写数据 读数据
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- 程序媛张三 2023-09-01
存储器：
74175：并行寄存器
74164：移位寄存器
DDR2：随机存储器
EEPROM: 理解引脚
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- 程序媛张三 2023-09-01
移位寄存器：
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- 程序媛张三 2023-09-01
章节目录：
时序逻辑电路的结构
寄存器
存储器
时序逻辑电路的结构：
寄存器：
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- 程序媛张三 2023-09-01
flash在掉电或其中的内容不会消失。
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- 程序媛张三 2023-09-01
U盘是nand flash
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- 程序媛张三 2023-09-01
D触发器：
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- 程序媛张三 2023-09-01
触发器特点：保存设备上的信号
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- 程序媛张三 2023-08-31
低电平为开始信号，校验位为了验证数据传输是否正确
奇偶校验的实现：
硬件描述语言实现功能
总结
异步：通信过程不需要时钟信号，是收到起始标志开始，收到停止标志结束。
串行：一个一个的排队发出和接受
校验：
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- 程序媛张三 2023-08-31
UART控制器
异步的传输，不需要时钟信号，串行接口。
特点：
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- 程序媛张三 2023-08-31
RS485总线：
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- 程序媛张三 2023-08-31
加法器与比较器
加法器：
比较器：
总结：
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